test/CodeGen/X86/vector-gep.ll

   1 ; RUN: llc < %s -march=x86 -mcpu=corei7-avx | FileCheck %s
   2 ; RUN: opt -instsimplify %s -disable-output
   3
   4 ;CHECK: AGEP0
   5 define <4 x i32*> @AGEP0(i32* %ptr) nounwind {
   6 entry:
   7   %vecinit.i = insertelement <4 x i32*> undef, i32* %ptr, i32 0
   8   %vecinit2.i = insertelement <4 x i32*> %vecinit.i, i32* %ptr, i32 1
   9   %vecinit4.i = insertelement <4 x i32*> %vecinit2.i, i32* %ptr, i32 2
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  18 ;CHECK: ret
  19 }
  20
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  22 define i32 @AGEP1(<4 x i32*> %param) nounwind {
  23 entry:
  24 ;CHECK: pslld
  25 ;CHECK: padd
  26   %A2 = getelementptr <4 x i32*> %param, <4 x i32> <i32 1, i32 2, i32 3, i32 4>
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  32
  33 ;CHECK: AGEP2
  34 define i32 @AGEP2(<4 x i32*> %param, <4 x i32> %off) nounwind {
  35 entry:
  36 ;CHECK: pslld
  37 ;CHECK: padd
  38   %A2 = getelementptr <4 x i32*> %param, <4 x i32> %off
  39   %k = extractelement <4 x i32*> %A2, i32 3
  40   %v = load i32* %k
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  46 define <4 x i32*> @AGEP3(<4 x i32*> %param, <4 x i32> %off) nounwind {
  47 entry:
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  59 entry:
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  69 entry:
  70 ;CHECK: pslld
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  76
  77