[ARM] Handling for coprocessor instructions that are undefined starting from ARMv8...

author Artyom Skrobov <Artyom.Skrobov@arm.com>

Fri, 8 Nov 2013 16:25:50 +0000 (16:25 +0000)

committer Artyom Skrobov <Artyom.Skrobov@arm.com>

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committer Artyom Skrobov <Artyom.Skrobov@arm.com>
Fri, 8 Nov 2013 16:25:50 +0000 (16:25 +0000)
diff --git a/lib/Target/ARM/ARMInstrThumb2.td b/lib/Target/ARM/ARMInstrThumb2.td

index 725e5054f728949024fbd908ed6c911f062d2812..48acffd3a64e290b9031627ca8c8c6bbd30490d8 100644 (file)
--- a/lib/Target/ARM/ARMInstrThumb2.td
+++ b/lib/Target/ARM/ARMInstrThumb2.td
@@ -3914,10 +3914,10 @@ defm t2LDC   : t2LdStCop<0b1110, 1, 0, "ldc">;
  defm t2LDCL  : t2LdStCop<0b1110, 1, 1, "ldcl">;
  defm t2STC   : t2LdStCop<0b1110, 0, 0, "stc">;
  defm t2STCL  : t2LdStCop<0b1110, 0, 1, "stcl">;
  defm t2LDCL  : t2LdStCop<0b1110, 1, 1, "ldcl">;
  defm t2STC   : t2LdStCop<0b1110, 0, 0, "stc">;
  defm t2STCL  : t2LdStCop<0b1110, 0, 1, "stcl">;
-defm t2LDC2  : t2LdStCop<0b1111, 1, 0, "ldc2">;
-defm t2LDC2L : t2LdStCop<0b1111, 1, 1, "ldc2l">;
-defm t2STC2  : t2LdStCop<0b1111, 0, 0, "stc2">;
-defm t2STC2L : t2LdStCop<0b1111, 0, 1, "stc2l">;
+defm t2LDC2  : t2LdStCop<0b1111, 1, 0, "ldc2">, Requires<[PreV8]>;
+defm t2LDC2L : t2LdStCop<0b1111, 1, 1, "ldc2l">, Requires<[PreV8]>;
+defm t2STC2  : t2LdStCop<0b1111, 0, 0, "stc2">, Requires<[PreV8]>;
+defm t2STC2L : t2LdStCop<0b1111, 0, 1, "stc2l">, Requires<[PreV8]>;
  
  
  //===----------------------------------------------------------------------===//
  
  
  //===----------------------------------------------------------------------===//
@@ -4063,7 +4063,9 @@ def t2MCR2 : t2MovRCopro<0b1111, "mcr2", 0,
               (outs), (ins p_imm:$cop, imm0_7:$opc1, GPR:$Rt, c_imm:$CRn,
                            c_imm:$CRm, imm0_7:$opc2),
               [(int_arm_mcr2 imm:$cop, imm:$opc1, GPR:$Rt, imm:$CRn,
               (outs), (ins p_imm:$cop, imm0_7:$opc1, GPR:$Rt, c_imm:$CRn,
                            c_imm:$CRm, imm0_7:$opc2),
               [(int_arm_mcr2 imm:$cop, imm:$opc1, GPR:$Rt, imm:$CRn,
-                            imm:$CRm, imm:$opc2)]>;
+                            imm:$CRm, imm:$opc2)]> {
+  let Predicates = [IsThumb2, PreV8];
+}
  def : t2InstAlias<"mcr2${p} $cop, $opc1, $Rt, $CRn, $CRm",
                    (t2MCR2 p_imm:$cop, imm0_7:$opc1, GPR:$Rt, c_imm:$CRn,
                            c_imm:$CRm, 0, pred:$p)>;
  def : t2InstAlias<"mcr2${p} $cop, $opc1, $Rt, $CRn, $CRm",
                    (t2MCR2 p_imm:$cop, imm0_7:$opc1, GPR:$Rt, c_imm:$CRn,
                            c_imm:$CRm, 0, pred:$p)>;
@@ -4078,7 +4080,9 @@ def : t2InstAlias<"mrc${p} $cop, $opc1, $Rt, $CRn, $CRm",
  
  def t2MRC2 : t2MovRCopro<0b1111, "mrc2", 1,
               (outs GPRwithAPSR:$Rt), (ins p_imm:$cop, imm0_7:$opc1, c_imm:$CRn,
  
  def t2MRC2 : t2MovRCopro<0b1111, "mrc2", 1,
               (outs GPRwithAPSR:$Rt), (ins p_imm:$cop, imm0_7:$opc1, c_imm:$CRn,
-                                  c_imm:$CRm, imm0_7:$opc2), []>;
+                                  c_imm:$CRm, imm0_7:$opc2), []> {
+  let Predicates = [IsThumb2, PreV8];
+}
  def : t2InstAlias<"mrc2${p} $cop, $opc1, $Rt, $CRn, $CRm",
                    (t2MRC2 GPRwithAPSR:$Rt, p_imm:$cop, imm0_7:$opc1, c_imm:$CRn,
                            c_imm:$CRm, 0, pred:$p)>;
  def : t2InstAlias<"mrc2${p} $cop, $opc1, $Rt, $CRn, $CRm",
                    (t2MRC2 GPRwithAPSR:$Rt, p_imm:$cop, imm0_7:$opc1, c_imm:$CRn,
                            c_imm:$CRm, 0, pred:$p)>;
@@ -4096,11 +4100,16 @@ def t2MCRR : t2MovRRCopro<0b1110, "mcrr", 0,
                                         imm:$CRm)]>;
  def t2MCRR2 : t2MovRRCopro<0b1111, "mcrr2", 0,
                             [(int_arm_mcrr2 imm:$cop, imm:$opc1, GPR:$Rt,
                                         imm:$CRm)]>;
  def t2MCRR2 : t2MovRRCopro<0b1111, "mcrr2", 0,
                             [(int_arm_mcrr2 imm:$cop, imm:$opc1, GPR:$Rt,
-                                           GPR:$Rt2, imm:$CRm)]>;
+                                           GPR:$Rt2, imm:$CRm)]> {
+  let Predicates = [IsThumb2, PreV8];
+}
+
  /* from coprocessor to ARM core register */
  def t2MRRC : t2MovRRCopro<0b1110, "mrrc", 1>;
  
  /* from coprocessor to ARM core register */
  def t2MRRC : t2MovRRCopro<0b1110, "mrrc", 1>;
  
-def t2MRRC2 : t2MovRRCopro<0b1111, "mrrc2", 1>;
+def t2MRRC2 : t2MovRRCopro<0b1111, "mrrc2", 1> {
+  let Predicates = [IsThumb2, PreV8];
+}
  
  //===----------------------------------------------------------------------===//
  // Other Coprocessor Instructions.
  
  //===----------------------------------------------------------------------===//
  // Other Coprocessor Instructions.
@@ -4127,6 +4136,8 @@ def t2CDP : T2Cop<0b1110, (outs), (ins p_imm:$cop, imm0_15:$opc1,
    let Inst{15-12} = CRd;
    let Inst{19-16} = CRn;
    let Inst{23-20} = opc1;
    let Inst{15-12} = CRd;
    let Inst{19-16} = CRn;
    let Inst{23-20} = opc1;
+
+  let Predicates = [IsThumb2, PreV8];
  }
  
  def t2CDP2 : T2Cop<0b1111, (outs), (ins p_imm:$cop, imm0_15:$opc1,
  }
  
  def t2CDP2 : T2Cop<0b1111, (outs), (ins p_imm:$cop, imm0_15:$opc1,
@@ -4150,6 +4161,8 @@ def t2CDP2 : T2Cop<0b1111, (outs), (ins p_imm:$cop, imm0_15:$opc1,
    let Inst{15-12} = CRd;
    let Inst{19-16} = CRn;
    let Inst{23-20} = opc1;
    let Inst{15-12} = CRd;
    let Inst{19-16} = CRn;
    let Inst{23-20} = opc1;
+
+  let Predicates = [IsThumb2, PreV8];
  }
  
  
  }
  
  
diff --git a/test/MC/ARM/v8_IT_manual.s b/test/MC/ARM/v8_IT_manual.s

index 9878f2d0c6f9818b62079832c3b5959662163e11..4b63aa82dd681f6463051a1cd4151043d2e55f43 100644 (file)
--- a/test/MC/ARM/v8_IT_manual.s
+++ b/test/MC/ARM/v8_IT_manual.s
@@ -1990,52 +1990,52 @@ it ge
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  @ CHECK: [[@LINE+2]]:1: warning: deprecated instruction in IT block
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+movwge r0, #40960
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+movwge r0, #45056
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+movwge r0, #49152
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+movwge r0, #53248
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+movwge r0, #61440
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+subwge r0, r1, #0
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+sbfxge r0, r12, #0, #1
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+bfige r0, r9, #0, #1
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+bfige r0, r10, #0, #1
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+bfige r0, r11, #0, #1
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-smlalge r0, r0, r5, r0
+bfige r0, r12, #0, #1
  @ CHECK: [[@LINE+2]]:1: warning: deprecated instruction in IT block
  it ge
  @ CHECK: [[@LINE+2]]:1: warning: deprecated instruction in IT block
  it ge
-smlalge r0, r0, r6, r0
+bfige r0, lr, #0, #1
  @ CHECK: [[@LINE+2]]:1: warning: deprecated instruction in IT block
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-smlalge r0, r0, r7, r0
+bfcge r0, #0, #1
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-smlalge r0, r0, r8, r0
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+usatge r0, #0, r1
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+usatge r0, #0, r2
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+usatge r0, #0, r3
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+usatge r0, #0, r4
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-cdp2ge p0, #15, c0, c12, c0, #0
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-cdp2ge p0, #15, c0, c13, c0, #0
+umlalge r0, r0, r11, r0
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-cdp2ge p0, #15, c0, c14, c0, #0
+umlalge r0, r0, r12, r0
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+umlalge r0, r0, lr, r0
diff --git a/test/MC/Disassembler/ARM/invalid-thumbv8.txt b/test/MC/Disassembler/ARM/invalid-thumbv8.txt

new file mode 100644 (file)

index 0000000..4c6b249
--- /dev/null
+++ b/test/MC/Disassembler/ARM/invalid-thumbv8.txt
@@ -0,0 +1,167 @@
+# RUN: not llvm-mc -disassemble %s -show-encoding -triple thumbv8 2>&1 | FileCheck %s
+
+# Coprocessors other than CP10, CP11, CP14 and CP15 are undefined in ARMv8;
+# but in ARMv7, all these instructions are valid
+
+# RUN: llvm-mc -triple thumbv7 -show-encoding -disassemble %s | FileCheck %s --check-prefix=CHECK-V7
+
+[0x00 0xee 0x00 0x01]
+# CHECK-V7: cdp
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xee 0x00 0x01]
+
+[0x00 0xee 0x00 0x0e]
+# CHECK-V7: cdp
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xee 0x00 0x0e]
+
+[0x00 0xee 0x00 0x0f]
+# CHECK-V7: cdp
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xee 0x00 0x0f]
+
+[0x00 0xfe 0x00 0x01]
+# CHECK-V7: cdp2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x00 0x01]
+
+[0x00 0xfe 0x00 0x0e]
+# CHECK-V7: cdp2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x00 0x0e]
+
+[0x00 0xfe 0x00 0x0f]
+# CHECK-V7: cdp2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x00 0x0f]
+
+[0x00 0xee 0x10 0x01]
+# CHECK-V7: mcr
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xee 0x10 0x01]
+
+[0x00 0xfe 0x10 0x01]
+# CHECK-V7: mcr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x10 0x01]
+
+[0x00 0xfe 0x10 0x0e]
+# CHECK-V7: mcr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x10 0x0e]
+
+[0x00 0xfe 0x10 0x0f]
+# CHECK-V7: mcr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x00 0xfe 0x10 0x0f]
+
+[0x10 0xee 0x10 0x01]
+# CHECK-V7: mrc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x10 0xee 0x10 0x01]
+
+[0x10 0xfe 0x10 0x01]
+# CHECK-V7: mrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x10 0xfe 0x10 0x01]
+
+[0x10 0xfe 0x10 0x0e]
+# CHECK-V7: mrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x10 0xfe 0x10 0x0e]
+
+[0x10 0xfe 0x10 0x0f]
+# CHECK-V7: mrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x10 0xfe 0x10 0x0f]
+
+[0x40 0xec 0x00 0x01]
+# CHECK-V7: mcrr
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x40 0xec 0x00 0x01]
+
+[0x40 0xfc 0x00 0x01]
+# CHECK-V7: mcrr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x40 0xfc 0x00 0x01]
+
+[0x40 0xfc 0x00 0x0e]
+# CHECK-V7: mcrr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x40 0xfc 0x00 0x0e]
+
+[0x40 0xfc 0x00 0x0f]
+# CHECK-V7: mcrr2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x40 0xfc 0x00 0x0f]
+
+[0x50 0xec 0x00 0x01]
+# CHECK-V7: mrrc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x50 0xec 0x00 0x01]
+
+[0x50 0xfc 0x00 0x0e]
+# CHECK-V7: mrrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x50 0xfc 0x00 0x0e]
+
+[0x50 0xfc 0x00 0x0f]
+# CHECK-V7: mrrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x50 0xfc 0x00 0x0f]
+
+[0x50 0xfc 0x00 0x01]
+# CHECK-V7: mrrc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x50 0xfc 0x00 0x01]
+
+[0x80 0xec 0x00 0x01]
+# CHECK-V7: stc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x80 0xec 0x00 0x01]
+
+[0x80 0xec 0x00 0x0f]
+# CHECK-V7: stc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x80 0xec 0x00 0x0f]
+
+[0x80 0xfc 0x00 0x01]
+# CHECK-V7: stc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x80 0xfc 0x00 0x01]
+
+[0x80 0xfc 0x00 0x0e]
+# CHECK-V7: stc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x80 0xfc 0x00 0x0e]
+
+[0x80 0xfc 0x00 0x0f]
+# CHECK-V7: stc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x80 0xfc 0x00 0x0f]
+
+[0x90 0xec 0x00 0x01]
+# CHECK-V7: ldc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x90 0xec 0x00 0x01]
+
+[0x90 0xec 0x00 0x0f]
+# CHECK-V7: ldc
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x90 0xec 0x00 0x0f]
+
+[0x90 0xfc 0x00 0x01]
+# CHECK-V7: ldc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x90 0xfc 0x00 0x01]
+
+[0x90 0xfc 0x00 0x0e]
+# CHECK-V7: ldc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x90 0xfc 0x00 0x0e]
+
+[0x90 0xfc 0x00 0x0f]
+# CHECK-V7: ldc2
+# CHECK: invalid instruction encoding
+# CHECK-NEXT: [0x90 0xfc 0x00 0x0f]
+
diff --git a/test/MC/Disassembler/ARM/thumb2-v8.txt b/test/MC/Disassembler/ARM/thumb2-v8.txt

index 04e192fd0b059b62b457dbe1e7bc3b906ba77b33..1b2f09562e2c4d2b484ab8422deb15e7222f7a10 100644 (file)
--- a/test/MC/Disassembler/ARM/thumb2-v8.txt
+++ b/test/MC/Disassembler/ARM/thumb2-v8.txt
@@ -3,3 +3,38 @@
  # CHECK: sevl.w
  0x50 0xbf
  0xaf 0xf3 0x05 0x80
  # CHECK: sevl.w
  0x50 0xbf
  0xaf 0xf3 0x05 0x80
+
+
+# These are the only coprocessor instructions that remain defined in ARMv8
+# (The operations on p10/p11 disassemble into FP/NEON instructions)
+
+0x00 0xee 0x10 0x0e
+# CHECK: mcr p14
+
+0x00 0xee 0x10 0x0f
+# CHECK: mcr p15
+
+0x10 0xee 0x10 0x0e
+# CHECK: mrc p14
+
+0x10 0xee 0x10 0x0f
+# CHECK: mrc p15
+
+0x40 0xec 0x00 0x0e
+# CHECK: mcrr p14
+
+0x40 0xec 0x00 0x0f
+# CHECK: mcrr p15
+
+0x50 0xec 0x00 0x0e
+# CHECK: mrrc p14
+
+0x50 0xec 0x00 0x0f
+# CHECK: mrrc p15
+
+0x80 0xec 0x00 0x0e
+# CHECK: stc p14
+
+0x90 0xec 0x00 0x0e
+# CHECK: ldc p14
+
author	Artyom Skrobov <Artyom.Skrobov@arm.com>
	Fri, 8 Nov 2013 16:25:50 +0000 (16:25 +0000)
committer	Artyom Skrobov <Artyom.Skrobov@arm.com>
	Fri, 8 Nov 2013 16:25:50 +0000 (16:25 +0000)
lib/Target/ARM/ARMInstrThumb2.td		patch \| blob \| history
test/MC/ARM/v8_IT_manual.s		patch \| blob \| history
test/MC/Disassembler/ARM/invalid-thumbv8.txt	[new file with mode: 0644]	patch \| blob
test/MC/Disassembler/ARM/thumb2-v8.txt		patch \| blob \| history