ARM: dts: rockchip: add core dtsi file for RK3126 and RK3128 SoCs
[firefly-linux-kernel-4.4.55.git] / arch / arm / boot / dts / rk3126.dtsi
index bd0973d3067cd022c3da3881fe79cdb0222f3c23..379cf2649e7871034b2ba2322f460c7b13cc96ba 100644 (file)
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-#include "rk312x.dtsi"
-
-&clk_gpll_div2 {
-       clocks = <&dummy>;
-};
+/*
+ * This file is dual-licensed: you can use it either under the terms
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+ *     FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
+ *     OTHER DEALINGS IN THE SOFTWARE.
+ */
 
-&clk_gpll_div3 {
-       clocks = <&dummy>;
-};
-
-
-&aclk_vio0_pre_div {
-       rockchip,flags = <CLK_SET_RATE_PARENT_IN_ORDER>;
-};
-
-&aclk_vio1_pre_div {
-        rockchip,flags = <CLK_SET_RATE_PARENT_IN_ORDER>;
-};
-
-&hclk_vio_pre_div {
-        rockchip,flags = <CLK_SET_RATE_PARENT_IN_ORDER>;
-};
+#include "rk312x.dtsi"
 
-&rockchip_clocks_init {
-       rockchip,clocks-init-parent =
-               <&clk_core &clk_apll>, <&aclk_cpu &clk_gpll>,
-               <&aclk_peri &clk_gpll>, <&clk_uart0_pll &clk_gpll>,
-               <&clk_uart2_pll &clk_gpll>, <&clk_i2s_2ch_pll &clk_gpll>,
-               <&clk_i2s_8ch_pll &clk_gpll>, <&clk_spdif_pll &clk_gpll>,
-               <&clk_vepu &clk_gpll>, <&clk_vdpu &clk_gpll>,
-               <&clk_hevc_core &clk_gpll>,
-               <&sclk_lcdc0 &clk_cpll>, <&clk_gpu &clk_gpll>,
-               <&clk_cif_pll &clk_gpll>, <&dclk_ebc &clk_gpll>,
-               <&clk_emmc &clk_gpll>, <&clk_sdio &clk_gpll>,
-               <&clk_sfc &clk_gpll>, <&clk_sdmmc0 &clk_gpll>,
-               <&clk_tsp &clk_gpll>, <&clk_nandc &clk_gpll>,
-               <&clk_mac_pll &clk_cpll>;
-};
+/ {
+       compatible = "rockchip,rk3126";
 
-&i2s0 {
-       /* sdi: 0: from io, 1: from acodec */
-       sdi_source = <1>;
-       status = "okay";
+       cru: clock-controller@20000000 {
+               compatible = "rockchip,rk3126-cru";
+               reg = <0x20000000 0x1000>;
+               rockchip,grf = <&grf>;
+               #clock-cells = <1>;
+               #reset-cells = <1>;
+       };
 };